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  • SystemVerilog语言实验

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  • 本次课程主要讲述了SystemVerilog语言实验,其所涉及的内容包括: 1、 进程管理 2、 精细的进程控制 3、 随机约束 4、 SystemVerilog与C语言的接口 5、 功能覆盖率

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简介

  • 课程概况:本次课程主要讲述了SystemVerilog语言实验,其所涉及的内容包括: 1、 进程管理 2、 精细的进程控制 3、 随机约束 4、 SystemVerilog与C语言的接口 5、 功能覆盖率
  • 标签: systemverilog、ststemverilog实验
  • 课程分类:FPGA
  • 语言: 中文
  • 总时长:00:57:03
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讲师简介

吴老师

拥有11年的数字芯片验证从业经验,有多款处理器芯片验证经验,参与架构和设计RISCV处理器,MIPS处理器等

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