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简介

1 1.[1.1.1]--第一章数字逻辑基础-数字电路概述、数制的表示方(Av414633253,P1) 00:28:56
2 2.[1.1.2]--第一章数字逻辑基础-编码的表示方法(Av414633253,P2) 00:44:05
3 3.[2.1.1]--第二章逻辑代数基础-逻辑代数的基本定理、法则和(Av414633253,P3) 00:33:09
4 4.[2.2.1]--第二章逻辑代数基础-逻辑函数的标准表达式和常用(Av414633253,P4) 00:33:29
5 5.[2.2.2]--第二章逻辑代数基础-最小项和最大项(Av414633253,P5) 00:26:18
6 6.[2.3.1]--第二章逻辑代数基础-逻辑函数的卡诺图化简法(Av414633253,P6) 00:41:58
7 7.[2.3.2]--第二章逻辑代数基础-非完全描述逻辑函数的卡诺图(Av414633253,P7) 00:41:05
8 8.[3.1.1]--第三章集成逻辑门电路-TTL门的内部结构分析(Av414633253,P8) 00:32:23
9 9.[3.2.1]--第三章集成逻辑门电路-主要特性参数及OC门(Av414633253,P9) 00:30:38
10 10.[3.2.2]--第三章集成逻辑门电路-三态门、CMOS门内部结(Av414633253,P10) 00:28:08
11 11.[4.1.1]--第四章组合电路的分析方法和分析实例(Av414633253,P11) 00:33:47
12 12.[4.2.1]--第四章组合逻辑电路的原理图设计方法与步骤、设计(Av414633253,P12) 00:45:08
13 13.[4.3.1]--第四章MSI组合逻辑部件（译码器、）的逻辑功能(Av414633253,P13) 00:47:20
14 14.[4.4.1]--第四章MSI组合逻辑部件（数据选择器）的逻辑功(Av414633253,P14) 00:40:26
15 15.[4.5.1]--第四章MSI组合逻辑部件的应用(Av414633253,P15) 00:42:14
16 16.[5.1.1]--第五章基本RS触发器(Av414633253,P16) 00:21:27
17 17.[5.1.2]--第五章钟控（RS、D、T、JK）触发器(Av414633253,P17) 00:49:04
18 18.[5.2.1]--第五章常用集成触发器的逻辑符号及时序图的画法(Av414633253,P18) 00:47:54
19 19.[6.1.1]--第六章时序逻辑电路的描述方法(Av414633253,P19) 00:38:39
20 20.[6.2.1]--第六章同步时序电路的分析方法1(Av414633253,P20) 00:43:56
21 21.[6.2.2]--第六章同步时序电路的分析方法2(Av414633253,P21) 00:45:56
22 22.[6.3.1]--第六章同步时序电路的一般设计方法和步骤1(Av414633253,P22) 00:41:07
23 23.[6.3.2]--第六章同步时序电路的一般设计方法和步骤2(Av414633253,P23) 00:41:00
24 24.[6.3.3]--第六章同步时序电路的一般设计方法和步骤3(Av414633253,P24) 00:40:33
25 25.[6.4.1]--第六章同步时序电路的一般设计方法和步骤(Av414633253,P25) 00:46:56
26 26.[6.4.2]--第六章时序电路设计实例(Av414633253,P26) 00:26:00
27 27.[7.1.1]--第七章常用集成时序逻辑器件-MSI计数器的逻辑(Av414633253,P27) 00:34:41
28 28.[7.2.1]--第七章常用集成时序逻辑器件-MSI计数器任意模(Av414633253,P28) 00:34:24
29 29.[7.3.1]--第七章常用集成时序逻辑器件-MSI移位寄存器的(Av414633253,P29) 00:45:15
30 30.[7.4.1]--第七章常用集成时序逻辑器件-移位型计数器和序列(Av414633253,P30) 00:34:52
31 31.[7.5.1]--第七章常用集成时序逻辑器件-序列码检测器和发生(Av414633253,P31) 00:34:15
32 32.[7.6.1]--第七章常用集成时序逻辑器件-序列码检测、MSI(Av414633253,P32) 00:37:20
33 33.[8.1.1]--第八章脉冲波形的产生与变换-555定时器、单稳(Av414633253,P33) 00:40:42
34 34.[8.2.2]--第八章脉冲波形的产生与变换-集成单稳态触发器、(Av414633253,P34) 00:44:14
35 35.[9.1.1]--第九章存储器和可编程逻辑器件-ROM和RAM的(Av414633253,P35) 00:40:07
36 36.[9.2.1]--第九章存储器和可编程逻辑器件-高密度可编程逻辑(Av414633253,P36) 00:47:50
37 37.[10.1.1]--VHDL描述方法1(Av414633253,P37) 00:40:40
38 38.[10.1.2]--VHDL描述方法2(Av414633253,P38) 00:40:40
39 39.[10.2.1]--组合电路的VHDL描述1(Av414633253,P39) 00:43:33
40 40.[10.2.2]--组合电路的VHDL描述2(Av414633253,P40) 00:29:28
41 41.[10.3.1]--时序电路的VHDL描述1(Av414633253,P41) 00:56:01
42 42.[10.3.2]--时序电路的VHDL描述2(Av414633253,P42) 00:32:05
43 43.[10.4.1]--时序电路的VHDL描述3(Av414633253,P43) 00:46:14
44 44.[10.4.2]--有限状态机设计1(Av414633253,P44) 00:36:52
45 45.[10.5.1]--有限状态机设计2(Av414633253,P45) 00:42:22
46 46.[10.5.2]--数字系统设计举例1(Av414633253,P46) 00:46:14
47 47.[11.1.1]--电子线路实验教学案例(Av414633253,P47) 00:13:11
48 48.[11.2.1]--电子线路实验教学案例(Av414633253,P48) 00:13:11

标签：FPGA
课程分类：FPGA
语言：中文
总时长：06:25:47

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课程概况：【数字电路及系统设计】西安电子科技大学
标签： FPGA
课程分类：FPGA
语言：中文
总时长：30:25:47

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00:28:56第1讲 1.[1.1.1]--第一章数字逻辑基础-数字电路概述、数制的表示方(Av414633253,P1)
00:44:05第2讲 2.[1.1.2]--第一章数字逻辑基础-编码的表示方法(Av414633253,P2)
00:33:09第3讲 3.[2.1.1]--第二章逻辑代数基础-逻辑代数的基本定理、法则和(Av414633253,P3)
00:33:29第4讲 4.[2.2.1]--第二章逻辑代数基础-逻辑函数的标准表达式和常用(Av414633253,P4)
00:26:18第5讲 5.[2.2.2]--第二章逻辑代数基础-最小项和最大项(Av414633253,P5)
00:41:58第6讲 6.[2.3.1]--第二章逻辑代数基础-逻辑函数的卡诺图化简法(Av414633253,P6)
00:41:05第7讲 7.[2.3.2]--第二章逻辑代数基础-非完全描述逻辑函数的卡诺图(Av414633253,P7)
00:32:23第8讲 8.[3.1.1]--第三章集成逻辑门电路-TTL门的内部结构分析(Av414633253,P8)
00:30:38第9讲 9.[3.2.1]--第三章集成逻辑门电路-主要特性参数及OC门(Av414633253,P9)
00:28:08第10讲 10.[3.2.2]--第三章集成逻辑门电路-三态门、CMOS门内部结(Av414633253,P10)
00:33:47第11讲 11.[4.1.1]--第四章组合电路的分析方法和分析实例(Av414633253,P11)
00:45:08第12讲 12.[4.2.1]--第四章组合逻辑电路的原理图设计方法与步骤、设计(Av414633253,P12)
00:47:20第13讲 13.[4.3.1]--第四章MSI组合逻辑部件（译码器、）的逻辑功能(Av414633253,P13)
00:40:26第14讲 14.[4.4.1]--第四章MSI组合逻辑部件（数据选择器）的逻辑功(Av414633253,P14)
00:42:14第15讲 15.[4.5.1]--第四章MSI组合逻辑部件的应用(Av414633253,P15)
00:21:27第16讲 16.[5.1.1]--第五章基本RS触发器(Av414633253,P16)
00:49:04第17讲 17.[5.1.2]--第五章钟控（RS、D、T、JK）触发器(Av414633253,P17)
00:47:54第18讲 18.[5.2.1]--第五章常用集成触发器的逻辑符号及时序图的画法(Av414633253,P18)
00:38:39第19讲 19.[6.1.1]--第六章时序逻辑电路的描述方法(Av414633253,P19)
00:43:56第20讲 20.[6.2.1]--第六章同步时序电路的分析方法1(Av414633253,P20)
00:45:56第21讲 21.[6.2.2]--第六章同步时序电路的分析方法2(Av414633253,P21)
00:41:07第22讲 22.[6.3.1]--第六章同步时序电路的一般设计方法和步骤1(Av414633253,P22)
00:41:00第23讲 23.[6.3.2]--第六章同步时序电路的一般设计方法和步骤2(Av414633253,P23)
00:40:33第24讲 24.[6.3.3]--第六章同步时序电路的一般设计方法和步骤3(Av414633253,P24)
00:46:56第25讲 25.[6.4.1]--第六章同步时序电路的一般设计方法和步骤(Av414633253,P25)
00:26:00第26讲 26.[6.4.2]--第六章时序电路设计实例(Av414633253,P26)
00:34:41第27讲 27.[7.1.1]--第七章常用集成时序逻辑器件-MSI计数器的逻辑(Av414633253,P27)
00:34:24第28讲 28.[7.2.1]--第七章常用集成时序逻辑器件-MSI计数器任意模(Av414633253,P28)
00:45:15第29讲 29.[7.3.1]--第七章常用集成时序逻辑器件-MSI移位寄存器的(Av414633253,P29)
00:34:52第30讲 30.[7.4.1]--第七章常用集成时序逻辑器件-移位型计数器和序列(Av414633253,P30)
00:34:15第31讲 31.[7.5.1]--第七章常用集成时序逻辑器件-序列码检测器和发生(Av414633253,P31)
00:37:20第32讲 32.[7.6.1]--第七章常用集成时序逻辑器件-序列码检测、MSI(Av414633253,P32)
00:40:42第33讲 33.[8.1.1]--第八章脉冲波形的产生与变换-555定时器、单稳(Av414633253,P33)
00:44:14第34讲 34.[8.2.2]--第八章脉冲波形的产生与变换-集成单稳态触发器、(Av414633253,P34)
00:40:07第35讲 35.[9.1.1]--第九章存储器和可编程逻辑器件-ROM和RAM的(Av414633253,P35)
00:47:50第36讲 36.[9.2.1]--第九章存储器和可编程逻辑器件-高密度可编程逻辑(Av414633253,P36)
00:40:40第37讲 37.[10.1.1]--VHDL描述方法1(Av414633253,P37)
00:40:40第38讲 38.[10.1.2]--VHDL描述方法2(Av414633253,P38)
00:43:33第39讲 39.[10.2.1]--组合电路的VHDL描述1(Av414633253,P39)
00:29:28第40讲 40.[10.2.2]--组合电路的VHDL描述2(Av414633253,P40)
00:56:01第41讲 41.[10.3.1]--时序电路的VHDL描述1(Av414633253,P41)
00:32:05第42讲 42.[10.3.2]--时序电路的VHDL描述2(Av414633253,P42)
00:46:14第43讲 43.[10.4.1]--时序电路的VHDL描述3(Av414633253,P43)
00:36:52第44讲 44.[10.4.2]--有限状态机设计1(Av414633253,P44)
00:42:22第45讲 45.[10.5.1]--有限状态机设计2(Av414633253,P45)
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00:13:11第47讲 47.[11.1.1]--电子线路实验教学案例(Av414633253,P47)
00:13:11第48讲 48.[11.2.1]--电子线路实验教学案例(Av414633253,P48)

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