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【公开课】EDA原理及应用 - 北京化工大学

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【公开课】EDA原理及应用（数字电路/基于Verilog HDL） - 北京化工大学
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课程概况：【公开课】EDA原理及应用（数字电路/基于Verilog HDL） - 北京化工大学
标签： EDA
课程分类：EDA
语言：中文
总时长：25:51:06

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00:21:12第1讲 1.第1章数字逻辑基础 1.1 数字逻辑发展史(Av71928908,P1)
00:30:58第2讲 2.第1章数字逻辑基础 1.2 Multisim spice仿真介绍和操作(Av71928908,P2)
00:29:11第3讲 3.第1章数字逻辑基础 1.3 开关系统(Av71928908,P3)
00:08:13第4讲 4.第1章数字逻辑基础 1.4 半导体数字集成电路(Av71928908,P4)
00:40:48第5讲 5.第1章数字逻辑基础 1.5 基本逻辑门电路分析（第一部分）(Av71928908,P5)
00:30:18第6讲 6.第1章数字逻辑基础 1.5 基本逻辑门电路分析（第二部分）(Av71928908,P6)
00:46:43第7讲 7.第1章数字逻辑基础 1.6 逻辑代数理论和表达式的化简(Av71928908,P7)
00:08:28第8讲 8.第1章数字逻辑基础 1.7 毛刺产生和消除(Av71928908,P8)
00:06:31第9讲 9.第1章数字逻辑基础 1.8 数字码制表示和转换(Av71928908,P9)
00:42:34第10讲 10.第2章数字逻辑电路 2.1 组合逻辑电路(第一部分)(Av71928908,P10)
00:44:44第11讲 11.第2章数字逻辑电路 2.1 组合逻辑电路（第二部分）(Av71928908,P11)
00:12:34第12讲 12.第2章数字逻辑电路 2.1 组合逻辑电路（第三部分）(Av71928908,P12)
00:42:57第13讲 13.第2章数字逻辑电路 2.2 时序逻辑电路(Av71928908,P13)
00:27:03第14讲 14.第2章数字逻辑电路 2.3 存储器分类及原理(Av71928908,P14)
00:44:35第15讲 15.第2章数字逻辑电路 2.4 有限自动状态机(Av71928908,P15)
00:44:20第16讲 16.第3章可编程逻辑器件工艺和结构 3.1 可编程逻辑器件发展历史(Av71928908,P16)
00:11:34第17讲 17.第3章可编程逻辑器件工艺和结构 3.2 可编程逻辑器件工艺(Av71928908,P17)
00:08:09第18讲 18.第3章可编程逻辑器件工艺和结构 3.3 简单可编程逻辑器件结构(Av71928908,P18)
00:01:59第19讲 19.第3章可编程逻辑器件工艺和结构 3.4 CPLD原理及结构(Av71928908,P19)
00:46:11第20讲 20.第3章可编程逻辑器件工艺和结构 3.5 FPGA原理及结构（第一部分）(Av71928908,P20)
00:39:24第21讲 21.第3章可编程逻辑器件工艺和结构 3.5 FPGA原理及结构（第二部分）(Av71928908,P21)
00:17:30第22讲 22.第4章 Vivado集成开发环境IP核设计流程 4.1 IP核基本概念(Av71928908,P22)
00:15:27第23讲 23.第4章 Vivado集成开发环境IP核设计流程 4.2 Vivado工具设(Av71928908,P23)
00:46:01第24讲 24.第4章 Vivado集成开发环境IP核设计流程 4.3 Vivado IP(Av71928908,P24)
00:06:59第25讲 25.第4章 Vivado集成开发环境IP核设计流程 4.4 Vivado IP(Av71928908,P25)
00:16:55第26讲 26.第5章 Vivado集成开发环境Verilog HDL设计流程 5.1 V(Av71928908,P26)
00:20:39第27讲 27.第5章 Vivado集成开发环境Verilog HDL设计流程 5.2~5(Av71928908,P27)
00:21:18第28讲 28.第5章 Vivado集成开发环境Verilog HDL设计流程 5.4~5(Av71928908,P28)
00:22:38第29讲 29.第5章 Vivado集成开发环境Verilog HDL设计流程 5.6~5(Av71928908,P29)
00:14:26第30讲 30.第5章 Vivado集成开发环境Verilog HDL设计流程 5.8~5(Av71928908,P30)
00:20:50第31讲 31.第5章 Vivado集成开发环境Verilog HDL设计流程 5.10 (Av71928908,P31)
00:37:45第32讲 32.第6章 Verilog HDL语言规范 6.2 Verilog HDL程序(Av71928908,P32)
00:31:31第33讲 33.第6章 Verilog HDL语言规范 6.3 Verilog HDL描述(Av71928908,P33)
00:25:08第34讲 34.第6章 Verilog HDL语言规范 6.4 Verilog HDL语言(Av71928908,P34)
00:25:09第35讲 35.第6章 Verilog HDL语言规范 6.5 Verilog HDL数据(Av71928908,P35)
00:43:41第36讲 36.第6章 Verilog HDL语言规范 6.5 Verilog HDL数据(Av71928908,P36)
00:41:48第37讲 37.第6章 Verilog HDL语言规范 6.6 Verilog HDL表达(Av71928908,P37)
00:09:08第38讲 38.第6章 Verilog HDL语言规范 6.7 Verilog HDL分配(Av71928908,P38)
00:12:35第39讲 39.第6章 Verilog HDL语言规范 6.8 Verilog HDL门级(Av71928908,P39)
00:18:43第40讲 40.第6章 Verilog HDL语言规范 6.10 Verilog HDL行(Av71928908,P40)
00:18:43第41讲 41.第6章 Verilog HDL语言规范 6.10 Verilog HDL行(Av71928908,P41)
00:13:31第42讲 42.第6章 Verilog HDL语言规范 6.11 Verilog HDL任(Av71928908,P42)
00:40:05第43讲 43.第6章 Verilog HDL语言规范 6.12 Verilog HDL层(Av71928908,P43)
00:19:11第44讲 44.第6章 Verilog HDL语言规范 6.17 Verilog HDL系(Av71928908,P44)
00:13:21第45讲 47.第6章基本逻辑单元Verilog HDL描述 6.3 时序逻辑电路Ver(Av71928908,P47)
00:39:01第46讲 45.第6章基本逻辑单元Verilog HDL描述 6.1 组合逻辑电路Ver(Av71928908,P45)
00:27:27第47讲 46.第6章基本逻辑单元Verilog HDL描述 6.2 数据运算操作Ver(Av71928908,P46)
00:06:55第48讲 48.第6章基本逻辑单元Verilog HDL描述 6.4 存储器Verilo(Av71928908,P48)
00:26:40第49讲 49.第6章基本逻辑单元Verilog HDL描述 6.5 有限自动状态机Ve(Av71928908,P49)
00:00:28第50讲 50.第7章复杂数字系统设计 7.1 梦幻呼吸灯的设计和演示（学生讲解）1_演(Av71928908,P50)
00:00:46第51讲 51.第7章复杂数字系统设计 7.1 梦幻呼吸灯的设计和演示（学生讲解）2_设(Av71928908,P51)
00:10:00第52讲 52.第7章复杂数字系统设计 7.1 梦幻呼吸灯的设计和演示（学生讲解）3_设(Av71928908,P52)
00:02:23第53讲 53.第7章复杂数字系统设计 7.2 七段数码管的驱动和演示（学生讲解）效果(Av71928908,P53)
00:06:43第54讲 54.第7章复杂数字系统设计 7.2 七段数码管的驱动和演示（学生讲解）设计(Av71928908,P54)
00:07:14第55讲 55.第7章复杂数字系统设计 7.3 七段数码管上贪吃蛇的实现和演示（学生讲解(Av71928908,P55)
00:25:58第56讲 56.第7章复杂数字系统设计 7.4 VGA驱动原理(Av71928908,P56)
00:16:41第57讲 57.第7章复杂数字系统设计 7.5 VGA上显示彩条的实现(Av71928908,P57)
00:11:13第58讲 58.第7章复杂数字系统设计 7.6 VGA上显示动态图像的实现(Av71928908,P58)
00:07:37第59讲 59.第7章复杂数字系统设计 7.7 VGA上显示运动图片的实现(Av71928908,P59)
00:10:22第60讲 60.第7章复杂数字系统设计 7.8 动态视频的捕获和图像处理的实现（学生讲解(Av71928908,P60)
00:07:47第61讲 61.第8章 IP核封装原理和实现 8.1 Vivdo定制IP流程导论(Av71928908,P61)
00:24:25第62讲 62.第8章 IP核封装原理和实现 8.2 IP核封装的实现(Av71928908,P62)
00:19:53第63讲 63.第8章 IP核封装原理和实现 8.3 IP核调用的实现(Av71928908,P63)
00:18:32第64讲 64.第9章 FPGA调试原理和调试实现 9.1 设计调试原理和方法(Av71928908,P64)
00:09:53第65讲 65.第9章 FPGA调试原理和调试实现 9.2 FIFO IP的生成和调用(Av71928908,P65)
00:37:55第66讲 66.第9章 FPGA调试原理和调试实现 9.2 FIFO IP的生成和调用2(Av71928908,P66)
00:21:25第67讲 67.第9章 FPGA调试原理和调试实现 9.3 网表插入探测流程方法及实现(Av71928908,P67)
00:09:41第68讲 68.第10章数字系统高级设计方法 10.1 数字系统设计目标(Av71928908,P68)
00:18:10第69讲 69.第10章数字系统高级设计方法 10.2 时序的基本概念(Av71928908,P69)
00:09:31第70讲 70.第10章数字系统高级设计方法 10.3 逻辑复制和复用(Av71928908,P70)
00:13:04第71讲 71.第10章数字系统高级设计方法 10.4 并行和流水线(Av71928908,P71)
00:19:54第72讲 72.第10章数字系统高级设计方法 10.5 同步和异步单元(Av71928908,P72)

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