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【公开课】可编程ASIC设计- 四川大学

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简介

1 1.1.1 集成电路和可编程ASIC(Av94672598,P1) 00:10:25
2 2.1.2 集成电路设计方法(Av94672598,P2) 00:09:41
3 3.1.3 传统FPGA的资源(Av94672598,P3) 00:09:46
4 4.1.4 DE2开发板上FPGA(Av94672598,P4) 00:10:54
5 5.2.1 DE2开发板资源(Av94672598,P5) 00:11:40
6 6.2.2 EDA设计工具（一）(Av94672598,P6) 00:14:37
7 7.2.3 EDA设计工具（二）(Av94672598,P7) 00:11:48
8 8.2.4 FPGA的分配与验证(Av94672598,P8) 00:16:35
9 9.3.1 Verilog HDL基本语法（一）(Av94672598,P9) 00:11:57
10 10.3.2 Verilog HDL基本语法（二）(Av94672598,P10) 00:10:30
11 11.3.3 Verilog HDL建模实例(Av94672598,P11) 00:11:31
12 12.4.1 FPGA设计中的仿真方法(Av94672598,P12) 00:08:25
13 13.4.2 Quartus II的下载验证(Av94672598,P13) 00:07:33
14 14.4.3 Quartus II的验证及调试工具(Av94672598,P14) 00:12:19
15 15.4.4.1 singal configuration的高级设置1(Av94672598,P15) 00:12:30
16 16.4.4.2 singal configuration的高级设置2(Av94672598,P16) 00:35:13
17 17.5.1.1 FPGA时序分析的基本知识和Quartus ii中时序分析工具(Av94672598,P17) 00:14:06
18 18.5.1.2 FPGA时序分析的基本知识和Quartus ii中时序分析工具(Av94672598,P18) 00:15:30
19 19.5.2 有限状态机的设计1(Av94672598,P19) 00:13:39
20 20.5.3.1 有限状态机的设计2-1(Av94672598,P20) 00:09:27
21 21.5.3.2 有限状态机的设计2-2(Av94672598,P21) 00:08:35
22 22.5.3.3 有限状态机的设计2-3(Av94672598,P22) 00:00:21
23 23.6.1 DSP Builder设计流程(Av94672598,P23) 00:09:38
24 24.6.2 如何完成simulink中建模(Av94672598,P24) 00:17:03
25 25.6.3 设计模型在FPGA上实现(Av94672598,P25) 00:12:16
26 26.6.4 FIR滤波器的项目(Av94672598,P26) 00:14:38
27 27.7.1 NiosII软核处理器(Av94672598,P27) 00:10:19
28 28.7.2 NiosII处理器系统案例(Av94672598,P28) 00:15:11
29 29.8.1 HPS介绍(Av94672598,P29) 00:09:54
30 30.8.2 可编程ASIC设计(Av94672598,P30) 00:09:59
31 31.9.1 Opencl的开发流程(Av94672598,P31) 00:10:03
32 32.9.2 认识openCL加速图像处理算法过程(Av94672598,P32) 00:10:50

标签：FPGA
课程分类：FPGA
语言：中文
总时长：06:26:53

【公开课】可编程ASIC设计（基于Verilog HDL/FPGA/Quarters）- 四川大学

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课程概况：【公开课】可编程ASIC设计（基于Verilog HDL/FPGA/Quarters）- 四川大学
标签： FPGA
课程分类：FPGA
语言：中文
总时长：6:26:53

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00:10:25第1讲 1.1.1 集成电路和可编程ASIC(Av94672598,P1)
00:09:41第2讲 2.1.2 集成电路设计方法(Av94672598,P2)
00:09:46第3讲 3.1.3 传统FPGA的资源(Av94672598,P3)
00:10:54第4讲 4.1.4 DE2开发板上FPGA(Av94672598,P4)
00:11:40第5讲 5.2.1 DE2开发板资源(Av94672598,P5)
00:14:37第6讲 6.2.2 EDA设计工具（一）(Av94672598,P6)
00:11:48第7讲 7.2.3 EDA设计工具（二）(Av94672598,P7)
00:16:35第8讲 8.2.4 FPGA的分配与验证(Av94672598,P8)
00:11:57第9讲 9.3.1 Verilog HDL基本语法（一）(Av94672598,P9)
00:10:30第10讲 10.3.2 Verilog HDL基本语法（二）(Av94672598,P10)
00:11:31第11讲 11.3.3 Verilog HDL建模实例(Av94672598,P11)
00:08:25第12讲 12.4.1 FPGA设计中的仿真方法(Av94672598,P12)
00:07:33第13讲 13.4.2 Quartus II的下载验证(Av94672598,P13)
00:12:19第14讲 14.4.3 Quartus II的验证及调试工具(Av94672598,P14)
00:12:30第15讲 15.4.4.1 singal configuration的高级设置1(Av94672598,P15)
00:35:13第16讲 16.4.4.2 singal configuration的高级设置2(Av94672598,P16)
00:14:06第17讲 17.5.1.1 FPGA时序分析的基本知识和Quartus ii中时序分析工具(Av94672598,P17)
00:15:30第18讲 18.5.1.2 FPGA时序分析的基本知识和Quartus ii中时序分析工具(Av94672598,P18)
00:13:39第19讲 19.5.2 有限状态机的设计1(Av94672598,P19)
00:09:27第20讲 20.5.3.1 有限状态机的设计2-1(Av94672598,P20)
00:08:35第21讲 21.5.3.2 有限状态机的设计2-2(Av94672598,P21)
00:00:21第22讲 22.5.3.3 有限状态机的设计2-3(Av94672598,P22)
00:09:38第23讲 23.6.1 DSP Builder设计流程(Av94672598,P23)
00:17:03第24讲 24.6.2 如何完成simulink中建模(Av94672598,P24)
00:12:16第25讲 25.6.3 设计模型在FPGA上实现(Av94672598,P25)
00:14:38第26讲 26.6.4 FIR滤波器的项目(Av94672598,P26)
00:10:19第27讲 27.7.1 NiosII软核处理器(Av94672598,P27)
00:15:11第28讲 28.7.2 NiosII处理器系统案例(Av94672598,P28)
00:09:54第29讲 29.8.1 HPS介绍(Av94672598,P29)
00:09:59第30讲 30.8.2 可编程ASIC设计(Av94672598,P30)
00:10:03第31讲 31.9.1 Opencl的开发流程(Av94672598,P31)
00:10:50第32讲 32.9.2 认识openCL加速图像处理算法过程(Av94672598,P32)

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